红色的“ERROR”字样不断闪烁，像警报灯。 “第五次仿真，还是失败，”李敏的声音沙哑，“时序违例，关键路径延迟超标15%。” 这是“麒麟001”优化版的第三次全芯片仿真。按照计划，3月20日要完成最终设计，送交台积电流片。但现在，仿真过不了，意味着设计有问题，不能流片。 会议室里坐了十几个人，都是各组的负责人。大家都熬了好几天，眼睛里布满血丝，但没人说累——因为累不是问题，问题是时间。 “问题出在哪里？”何庭波问，她刚从华为总部开会回来，也加入了熬夜队伍。 李敏调出详细报告：“主要是时钟树设计太复杂。为了降低功耗，我们用了动态时钟门控技术，但导致时钟偏移变大，关键路径时序紧张。” 王建国补充：“还有电源噪声...

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